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标题: PCI&LVDS产品开发平台(RPDP-PCI&LVDS) [打印本页]
作者: dz51demo    时间: 10.11.2007 09:12
标题: PCI&LVDS产品开发平台(RPDP-PCI&LVDS)
【产品价格】
% k  D" v: A+ e# S. J3 k- B9 ]6 F 标准版: ￥25005 d1 G. G- N# z7 x% j
* J% @$ K, h5 p: r" v$ `- \. V- @
【产品定位】- T3 I4 }8 d- [7 M) j+ d9 m; `0 U8 S
基于PCI的高速数据采集卡开发
6 K% o# j' m0 R7 C4 H+ j基于LVDS接口的高速数据采集处理卡；
4 l  t' I7 K$ W) i  [7 p* x. s# D0 Y算法加速卡;& @7 U, O4 o7 I1 X5 \

1 _8 D3 l) y& J) Q4 P) ]9 w2 C' g! X) S& f- R& C) o5 j
【产品特色】
* q* R1 n1 z' a7 Z* `5 q提供完整的FPGA+PCI解决方案，性能稳定,兼容性好；: H( c4 x: F6 w1 p* {0 [% S
提供完整的参考设计,包括FPGA代码,驱动程序,应用程序等,可以作为项目开发的模板;, w' p' Q' R- b8 K4 N
扩展性能好，可以扩展音频输入输出卡，视频输入输出卡，高速AD，DA等。5 u+ z6 A4 u% j+ A

& y. Q0 e. f) j+ ` * Q7 o8 }" u' z
【产品清单】
  c$ d+ _% A2 y/ b1、RPDP-PCI&LVDS开发板       1块' O- Z- S+ C9 y0 a  d3 j
2、ByteBlasterII 下载电缆    1条
' ?. F* b  n4 y- O) [  n4 C3、配套DVD光盘               1张2 w5 F$ F7 r: I2 S% z+ K1 ^3 X
) S) ?" L$ B7 i/ T! O+ }. t2 @/ C
. F- q0 b8 G% ~  g  Y6 K
【硬件资源】
( Z; |. ]2 `% e" A5 w1、FPGA芯片：" z5 y0 J2 Z2 e7 t
      标准版：EP1C6Q240， 包括12,060LEs，相当于15万门左右
1 f4 l8 k/ s- [' K- r      增强版：EP1C12Q240，包括12,060LEs，相当于30万门左右/ I* ^3 u! N& ]$ u$ k
2、配置芯片：
( W2 D! L' |3 o3 j  a      增强版：EPCS1，1Mbit储存量，支持AS和JTAG两种配置模式6 H3 Z* \: [: |6 p3 ^  a
      增强版：EPCS4，4Mbit储存量，支持AS和JTAG两种配置模式, D5 f! a2 l* M9 {* s3 U
3、8M Byte 高速SDARM0 m) L- V. U  l
      一片2M×32Bit SDRAM ，4个Bank，最高166MHz读写速度；- i0 }$ i% v# b6 _+ g
4、LVDS扩展接口（DB62接口）/ R2 x0 N* F0 c% k4 F' q, r
      同时提供提供：8 v9 s4 ]0 w+ M+ N3 c9 f( ~
      12路LVDS信号输出；
) E) `/ [7 T+ a      12路LVDS信号输入；+ V/ p; y$ }: `
      12路LVTTL信号（输入输出可编程）
7 q% h4 n& e. w$ b2 @0 ?- g2 I9 K
) d) J! K- z9 m5、RedLogic扩展接口（VME48接口）- w3 S& P+ h% C
      提供32路LVTTL信号，其中包括一路专用时钟输入和一路专用时钟输出.通过相应的扩展板，可以实现Video，Audio和高 速AD/DA等应用。用户也可以开发自己定义的接口板。
2 j* A: V* a9 [: P! E) I1 m# X, L. q: W3 N  b
【配套软件】
% v, ]' S- s! m" |1、 相关开发工具软件
) t  B$ s, i) C2、 开发实例及文档1 d! y: V: g. J  V- q6 `
3、 FPGA和ASIC设计资源库" P* S: _1 p7 J. Y# `0 {; b2 D: w$ U

* v8 G( ^1 y8 N7 l" |【设计文档】
, s0 v( ?+ f' k8 M8 C1、开发板用户手册
' s6 `4 @& C& ]- }: S2、开发板原理图和PCB（Protel99SE格式）9 f$ i' d( }: D! P; K  {% H, g
3、QuartusII和NIOSII IDE安装指导和入门教程; |4 [( O9 X2 _% d1 C
4、主要芯片的数据手册和仿真模型（Verilog HDL语言描述）! }: J! t2 s+ h' j
/ E7 O3 p0 i$ O% W  K! E4 g! c# k! O
【开发实例】) ]' O% i& _, O) K5 |) p
● BASE64解码算法
% {( t- D% b' R* w3 B2 K2 t        Base64编码
( f# W7 H( P7 ]& ~        Base64是网络上最常见的用于传输8Bit字节代码的编码方式之一，大家可以查看RFC2045～RFC2049，上面有MIME的详细规范。
* v. d; ]# J7 V/ S$ w0 V        Base64要求把每三个8Bit的字节转换为四个6Bit的字节（3*8 = 4*6 = 24），然后把6Bit再添两位高位0，组成四个8Bit的字节，也就是说，转换后的字符串理论上将要比原来的长1/3。  k6 [) z# N% p. l+ Y" \
        本设计完成了BASE64解码算法的FPGA程序设计和验证。
& Y  M' V6 G+ T5 J" r( A
/ |2 ^6 U, x) X5 p* \9 J) o; U ● 数据采集卡
, _( L3 q' ?4 [, z" P' U* r        FPGA内部产生数据源，主机端程序响应pci卡发出的中断信号，将硬件板卡中的数据传入主机，并将数据在界面上显示相应的数据以及接收到的帧数。将收到的数据存入硬盘，以便查看。0 ]4 x" r) g/ k( {/ f8 f/ L
4 D+ m6 _- p' b4 [5 ?
. Q: _! D; q& k: s
% g6 U$ P1 f0 b# |
% j6 ]' L* [3 {# N3 {1 q

# ~- n6 k( s& A5 E1 v' T8 w
& l7 X/ h) J: Z' |
$ Z4 S( m% l# T8 ^特别声明：2 D$ k/ a0 k& D0 l, z: g) _
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         010-82625208        手机:13671276968  2 f# m8 s. H1 h; m" d4 {9 T1 ^
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