PCI&LVDS产品开发平台(RPDP-PCI&LVDS)

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【产品价格】
标准版: ￥2500

9 T% j+ v: [2 M! [【产品定位】
( J8 s& {2 `$ H* z: t# C基于PCI的高速数据采集卡开发
; M& W7 i0 |2 O/ _8 M% K7 H基于LVDS接口的高速数据采集处理卡；
9 U- A0 f5 m& m$ H# y. S算法加速卡;
3 X$ T9 Z- ~& a5 Q' n- g

- o: x' p5 F0 G( v" I& A, G【产品特色】
9 d8 }) L* S/ i  E) {& m* r; n% A提供完整的FPGA+PCI解决方案，性能稳定,兼容性好；
! u9 Y* x* h4 A$ i0 S7 G提供完整的参考设计,包括FPGA代码,驱动程序,应用程序等,可以作为项目开发的模板;
( x) T, ^/ N: D8 O% Y# ]5 w扩展性能好，可以扩展音频输入输出卡，视频输入输出卡，高速AD，DA等。

. X/ V" A. g; T( I) p+ D
【产品清单】
1、RPDP-PCI&LVDS开发板       1块
! T) ]1 N) O! {2、ByteBlasterII 下载电缆    1条
3、配套DVD光盘               1张
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0 W+ w5 v  ~5 b8 D- _+ U  T
【硬件资源】
4 ~+ b% r8 f# d6 ^% A. v. d1、FPGA芯片：
4 |0 }. X& k7 U& W- E2 B# g      标准版：EP1C6Q240， 包括12,060LEs，相当于15万门左右
  x. V$ w: {2 D      增强版：EP1C12Q240，包括12,060LEs，相当于30万门左右
' s( z- \' b$ {! b% P2、配置芯片：
      增强版：EPCS1，1Mbit储存量，支持AS和JTAG两种配置模式
      增强版：EPCS4，4Mbit储存量，支持AS和JTAG两种配置模式
5 X0 s( B, g( e& X+ x6 E3、8M Byte 高速SDARM
- {! K! W" o1 n8 |# h/ p      一片2M×32Bit SDRAM ，4个Bank，最高166MHz读写速度；
6 @2 m( X8 x5 t7 l4、LVDS扩展接口（DB62接口）
      同时提供提供：
      12路LVDS信号输出；
7 H; Q# w# u; u# U      12路LVDS信号输入；
      12路LVTTL信号（输入输出可编程）

+ `+ O& `# V, U1 O- p' \6 e5、RedLogic扩展接口（VME48接口）
% W$ i. r! R6 O; ]      提供32路LVTTL信号，其中包括一路专用时钟输入和一路专用时钟输出.通过相应的扩展板，可以实现Video，Audio和高 速AD/DA等应用。用户也可以开发自己定义的接口板。

1 B2 N& s8 n- u, Z【配套软件】
1、 相关开发工具软件
2、 开发实例及文档
# t) O1 L" U9 p3、 FPGA和ASIC设计资源库
! {+ `; V6 y. ^  J: ?: I1 C9 Z4 i
* o/ f- ^/ p  x8 m! g【设计文档】
1、开发板用户手册
2、开发板原理图和PCB（Protel99SE格式）
3、QuartusII和NIOSII IDE安装指导和入门教程
( d9 u; i+ A$ O4、主要芯片的数据手册和仿真模型（Verilog HDL语言描述）
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1 |$ t0 S* \0 z) k% T4 D. N# \* p【开发实例】
● BASE64解码算法
5 b& C1 C, ^) T        Base64编码
1 N  _7 l3 }3 k, F        Base64是网络上最常见的用于传输8Bit字节代码的编码方式之一，大家可以查看RFC2045～RFC2049，上面有MIME的详细规范。
& u9 L5 z# q' u( l2 e' ?7 Y        Base64要求把每三个8Bit的字节转换为四个6Bit的字节（3*8 = 4*6 = 24），然后把6Bit再添两位高位0，组成四个8Bit的字节，也就是说，转换后的字符串理论上将要比原来的长1/3。
        本设计完成了BASE64解码算法的FPGA程序设计和验证。

● 数据采集卡
        FPGA内部产生数据源，主机端程序响应pci卡发出的中断信号，将硬件板卡中的数据传入主机，并将数据在界面上显示相应的数据以及接收到的帧数。将收到的数据存入硬盘，以便查看。

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